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Motore di ricerca datesheet componenti elettronici |
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SM32VC5510AGGWA2EP Scheda tecnica(PDF) 5 Page - Texas Instruments |
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SM32VC5510AGGWA2EP Scheda tecnica(HTML) 5 Page - Texas Instruments |
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5 / 82 page  Figures v August 2003 − Revised November 2003 SGUS045A List of Figures Figure Page 2−1. 320VC5510 GGW MicroStar BGAE Package (Bottom View) 3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−1. 320VC5510 Functional Block Diagram 12 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−2. 320VC5510 Memory Map 15 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−3. System Register (SYSR) Bit Layout 17 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−4. EHPI Memory Map 19 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−5. I/O Direction Register (IODIR) Bit Layout 20 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−6. I/O Data Register (IODATA) Bit Layout 20 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−7. IFR0, IER0, DBIFR0, and DBIER0 Bit Locations 34 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3−8. IFR1, IER1, DBIFR1, and DBIER1 Bit Locations 34 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4−1. Device Nomenclature for the 320VC5510 37 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−1. 3.3-V Test Load Circuit 40 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−2. Bypass Mode Clock Timing 42 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−3. External Multiply-by-N Clock Timing 43 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−4. Asynchronous Memory Read Timing 45 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−5. Asynchronous Memory Write Timing 46 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−6. SBSRAM Read Timing 48 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−7. SBSRAM Write Timing 48 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−8. Two SDRAM Read Commands (Active Row) 50 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−9. Two SDRAM WRT Commands (Active Row) 50 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−10. SDRAM ACTV Command 51 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−11. SDRAM DCAB Command 51 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−12. SDRAM REFR Command 52 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−13. SDRAM MRS Command 52 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−14. HOLD/HOLDA Timing 53 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−15. Reset Timing 54 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−16. External Interrupt Timing 55 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−17. XF Timing 55 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−18. General-Purpose Input/Output (IOx) Signal Timings 56 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−19. TIN/TOUT Timing When Configured as Inputs 57 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−20. TIN/TOUT Timing When Configured as Outputs 57 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−21. McBSP Receive Timings 60 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−22. McBSP Transmit Timings 60 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−23. McBSP General-Purpose I/O Timings 61 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−24. McBSP Timing as SPI Master or Slave: CLKSTP = 10b, CLKXP = 0 62 . . . . . . . . . . . . . . . . . . . . . . . . . 5−25. McBSP Timing as SPI Master or Slave: CLKSTP = 11b, CLKXP = 0 63 . . . . . . . . . . . . . . . . . . . . . . . . . 5−26. McBSP Timing as SPI Master or Slave: CLKSTP = 10b, CLKXP = 1 64 . . . . . . . . . . . . . . . . . . . . . . . . . 5−27. McBSP Timing as SPI Master or Slave: CLKSTP = 11b, CLKXP = 1 65 . . . . . . . . . . . . . . . . . . . . . . . . . 5−28. EHPI Nonmultiplexed Read/Write Timings 67 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5−29. EHPI Multiplexed Memory (HPID) Access Read/Write Timings Without Autoincrement 68 . . . . . . . . . . 5−30. EHPI Multiplexed Memory (HPID) Access Read Timings With Autoincrement 69 . . . . . . . . . . . . . . . . . . |
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