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HT46RB70 Scheda tecnica(PDF) 34 Page - Holtek Semiconductor Inc |
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HT46RB70 Scheda tecnica(HTML) 34 Page - Holtek Semiconductor Inc |
34 / 49 page HT46RB70 Rev. 1.40 34 2017-04-05 读写 FIFO 时必须按照一定时序进行。通过设定 MISC 寄存器位,MCU 对 FIFO 可以执行读、写和 清除动作。下表为一些读、写和清除 FIFO 的时序。 动作 MISC 设置和状态 读 FIFO0 时序 00H→01H→延时 2 μs,检查是否为 41H(准备好)或 01H(未准备 好)→从 FIFO0 寄存器读取*→03H→02H 写 FIFO0 时序 02H→03H→延时 2 μs,检查是否为 43H(准备好)或 03H(未准备 好)→写数据到 FIFO0 寄存器*→01H→00H 检查 FIFO0 是否可读 00H→01H 延时 2 μs,检查是否为 41H(准备好)或 01H(未准备好) →00H 检查 FIFO0 是否可写 02H→03H 延时 2 μs,检查是否为 43H(准备好)或 03H(未准备好) →02H 从 FIFO0 内读取 0 封包 00H→01H→延时 2 μs,检查是否为 81H→读取(01H) →03H→ 02H 写 0 封包到 FIFO0 内 02H→03H→延时 2 μs,检查是否为 03H→07H→06H→00H 读或写 FIFO 注意:*:在两次读与写之间必须存在 2 μs 延时 Req. Ready Tx Read FIFO Timing Req. Ready Tx Write FIFO Timing 位 标号 R/W 功能 0 DATATG* R/W 触发此位,所有 DATA 封包都会从 DATA0 开始 1 SETIO1** R/W 设置端点 1 为输入或输出(1/0),默认为输入(1) 2 SETIO2** R/W 设置端点 2 为输入或输出(1/0),默认为输入(1) 3 SETIO3** R/W 设置端点 3 为输入或输出(1/0),默认为输入(1) 4 SETIO4** R/W 设置端点 4 为输入或输出(1/0),默认为输入(1) 5 SETIO5** R/W 设置端点 5 为输入或输出(1/0),默认为输入(1) 6~7 — — 未用,读出为“0” SETIO(27H) 寄存器 注意:*USB 设置:当主机发出“set Configuration”,数据管道会先发出 DATA0。所以,当设备接收到“set Configuration” 封包,必须设置此位以确保数据从 DATA0 开始。 **必须设置数据管道为输入管道还是输出管道。主要用于防止主机错误的发送 IN 或 OUT 封包或禁止端点。 |
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